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科研机构
北京大学 [1]
内容类型
期刊论文 [1]
发表日期
2014 [1]
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Constructing Sub-Arrays with Short Interconnects from Degradable VLSI Arrays
期刊论文
ieee transactions on parallel and distributed systems, 2014
Wu Jigang
;
Srikanthan, Thambipillai
;
Jiang, Guiyuan
;
Wang, Kai
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提交时间:2015/11/11
Reconfiguration
degradable VLSI array
fault tolerance
routing
algorithm
FAULT-TOLERANT MESHES
RECONFIGURATION SCHEME
SELF-TEST
EFFICIENT
PROCESSORS
SWITCHES
DESIGNS
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