集成电路后端设计优化关键技术研究

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题名	集成电路后端设计优化关键技术研究
作者	路卢
学位类别	工学博士
答辩日期	2009-07-02
授予单位	中国科学院研究生院
授予地点	中国科学院自动化研究所
导师	彭思龙
关键词	电路版图标准单元互连线结构化ASIC 特征化逻辑效力流程优化 circuit layout standard cell interconnect structured ASIC characterize Logical Effort flow optimization
其他题名	Research on Backend VLSI Design Optimization Techniques
学位专业	计算机应用技术
中文摘要	集成电路后端设计优化在集成电路设计过程中具有重要地位，包括一系列重要环节。本文针对集成电路后端设计优化中的问题，在如下几个方面开展了研究工作。 1. 针对结构化ASIC 单元设计问题，给出了一种具有良好可制造性、功能编程灵活性的细粒度的结构化ASIC 标准单元和互连线结构；给出了基于细粒度结构化ASIC 单元的步骤灵活的后端设计流程。 2. 针对单元性能参量特征化技术需求，给出了一个基于MC/DC 的高测试覆盖率的测试向量组生成方法；给出了全面揭示管脚种类、单元工作状态、可测参量等内容的相关性的关系矩阵；给出了一个基于开源脚本的易用的自动化标准单元性能特征化流程。 3. 将互连线负载引入现有逻辑效力方法，给出了一个简洁的扩展逻辑效力方法；基于经验证的仿真平台，给出了该方法公式的可靠的参数获取方法；以扩展逻辑效力方法为基础，结合路径延迟约束信息和版图设计约束，给出了一个计算效率高且易于工程使用的逻辑路径延迟优化方法。理论和实验分析表明，上述各项技术在提升集成电路后端设计性能指标方面具有不同的作用，并在实践中取得了较好的效果。
英文摘要	Backend VLSI design plays an important role in VLSI design. In this thesis, several backend design techniques that may result good design outputs are proposed. 1. A group of fine-grained structured ASIC cells along with their metal interconnect structure, as well as modified backend design flow based on proposed structured ASIC solution are proposed aiming at better manufacture regularity, via programming ability and flow flexibility. 2. A MC/DC based method is proposed to help generating high coverage stimulus vectors. An open source script based fully automated characterizing flow is proposed upon thoroughly investigation of cell’s running conditions, measurable parameters and testing netlist files. 3. Extension on Logical Effort in awareness of interconnect delay is proposed along with a detail explanation of parameters calibrating method. The proposed Extended Logical Effort based path delay optimization flow can find both optimal gate sizes and interconnect wire segment lengths in high efficiency. Both analysis and experiments show that, techniques proposed here may bring various improvements on final design result.
语种	中文
其他标识符	200618014629093
内容类型	学位论文
源URL	[http://ir.ia.ac.cn/handle/173211/6225]
专题	毕业生_博士学位论文
推荐引用方式 GB/T 7714	路卢. 集成电路后端设计优化关键技术研究[D]. 中国科学院自动化研究所. 中国科学院研究生院. 2009.