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	基于90nm CMOS工艺的12GHz二分频器
	周春元 ; 李国林 ; ZHOU Chunyuan ; LI Guolin
	2010-05-12 ; 2010-05-12
关键词	分频器 电流模式逻辑 锁相环 Frequency divider Current mode logic (CML) Phase locked loop (PLL) TN772
其他题名	A 12 GHz Divided-by-2 Frequency Divider Based on 90 nm CMOS Process
中文摘要	采用90nm CMOS工艺,实现了一个基于电流模式逻辑的12GHz二分频器。该分频器具有很宽的锁定频率范围(1～12GHz),在输入信号频率为8GHz时,输入灵敏度达到-30dBm。分频器工作在1.2V电源电压下,消耗的电流大约为1.5mA。给出了该设计的后仿真结果。; A 12 GHz divided-by-2 frequency divider based on current mode logic (CML)was implemented using 90 nm CMOS process technology.The divider showed a wide frequency locking range from 1 GHz to 12 GHz, and it had an input sensitivity as high as -30 dBm at 8 GHz.The device drew around 1.5 mA of current from a 1.2 V supply.Post simulation has been done for this design.
语种	中文 ; 中文
内容类型	期刊论文
源URL	[http://hdl.handle.net/123456789/28549]
专题	清华大学
推荐引用方式 GB/T 7714	周春元,李国林,ZHOU Chunyuan,等. 基于90nm CMOS工艺的12GHz二分频器[J],2010, 2010.
APA	周春元,李国林,ZHOU Chunyuan,&LI Guolin.(2010).基于90nm CMOS工艺的12GHz二分频器..
MLA	周春元,et al."基于90nm CMOS工艺的12GHz二分频器".(2010).

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